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  • 量化補缺與量化壓縮
    量化補償與量化壓縮  學習博客://lhtao31.blog.163.com/blog/static/2972647020103814044158/   最近在學習調試攝像頭,配置OV7670攝像頭采集到的數據是RGB565,移植別人的代碼,從ZYNQ移
    網友分享于:2017-10-18 11:52:11
  • 關于AVALON總路線動態地址對齊
    關于AVALON總線動態地址對齊       在NIOS的使用中,我們往往要用到自定義外設,然后通過AVALON交換架構和NIOSII進行通信。            AVA
    網友分享于:2017-10-10 12:55:52
  • verilog-舉動級描述和結構級描述
    verilog--行為級描述和結構級描述1、在使用verilog描述電路時,既可以進行行為級的描述,也可以進行結構級的描述。       ①行為級描述:側重對??樾形δ艿某橄竺枋?。       ②結構級描述
    網友分享于:2017-10-10 12:55:52
  • 基于FPGA的侵蝕膨脹算法實現
    基于FPGA的腐蝕膨脹算法實現         本篇文章我要寫的是基于的腐蝕膨脹算法實現,腐蝕膨脹是形態學圖像處理的基礎,,腐蝕在二值圖像的基礎上做“收縮”或“細化”操作,膨脹在二值圖像的基礎上做“加
    網友分享于:2017-10-07 20:18:33
  • 基于FPGA驅動VGA顯示圖片的小疑點
    基于FPGA驅動VGA顯示圖片的小問題         學習VGA顯示圖片的過程中,遇到了一個小問題,我在顯示屏上開了一個60x60的框,放了一張圖片進去顯示,但是最終的結果如下圖所示。   出現了一個豎黑邊,看了看代碼,
    網友分享于:2017-10-07 20:18:33
  • 串口發送??欏蛔紙謔莘⑺?/a>
    串口發送??欏?字節數據發送  設計思想與代碼規范均借鑒明德揚至簡設計法,有不足之處希望大家多提建議,真正做到至簡設計。本篇著重提出FPGA通用設計思想,以計數器為核心的代碼規范以及VIVADO debug操作流程。   此次試驗旨在通過串口試驗,講述FPGA
    網友分享于:2017-08-21 14:24:37
  • 基于FPGA的VGA展示靜態圖片
    基于FPGA的VGA顯示靜態圖片  終于熬到暑假了,記過三四周的突擊帶考試,終于為我的大二畫上了一個完整的句號,接下來終于可以靜心去做自己想做的事情了,前一陣子報了一個線上培訓班,學學Sobel邊緣檢測,之前一直在學習圖像處理,但是因為一直看人家的代碼,到后來
    網友分享于:2017-08-21 14:24:37
  • nRF2401無線??榻郵誣FPGA實現~
    nRF2401無線??榻郵誣FPGA實現~~    最近膠囊內窺鏡項目中用到了業界常用的無線收發???,即恩智浦公司nRF系列無線收發???,該??櫚鼻壩瀉眉鋼盅≡?,比如nRF24L01只有無線收發???,需要外部MCU進行驅動及
    網友分享于:2017-08-15 14:35:09
  • 全網始創ISE入門級教程
    全網首創ISE入門級教程   轉眼間我已經大三了,現在成為了實驗室的負責人,對于下一屆學生的納新重任就交到了我的手上,想采取不同的方法暑假盡可能對他們進行一些培訓,所以制作了此教程,說實話,在網上還沒有找到關于ISE的入門級使用教程呢!可謂是全網首創??!話不多說,我們趕緊看看我的處女視頻
    網友分享于:2017-08-15 14:35:09
  • 狀態機設計——從容易的按鍵消抖開始
    狀態機設計——從簡單的按鍵消抖開始  目前筆者正在接受明德揚FPGA網上培訓班的培訓,講的內容非常適合新手,且以練習和互動答疑的教學模式讓我學到了很多東西。由于是根據自身時間安排進度的,所以戰線拉的比較長,發現做些設計總結非常重要,可以幫助自己理清思路,同時也能得到很
    網友分享于:2017-08-15 14:35:09
  • Modelsim使用常見有關問題集錦(實時更新)
    Modelsim使用常見問題集錦(實時更新)1.Modelsim使用時出現閃退情況,解決辦法:(1)請再次查看modelsim是否破解完全;(2)電腦上安裝的文件與Modelsim有沖突,多半是愛奇藝這個軟件,刪掉愛奇藝軟件。 2.再利用mo
    網友分享于:2017-07-21 18:43:24
  • FPGA基礎知識(3)典型FPGA開發流程
    FPGA基礎知識(三)典型FPGA開發流程FPGA的設計流程就是利用EDA開發軟件和編程工具對FPGA芯片進行開發的過程。FPGA的開發流程一般下如圖所示,包括電路設計、設計輸入、功能仿真、綜合優化、綜合后仿真、實現、布線后仿真、板級仿真以及芯片編程與調試等主要步驟。   1. 電路設計 在系統
    網友分享于:2017-07-12 16:03:16
  • MATLAB設計不同構造的FIR或IIR濾波器
    MATLAB設計不同結構的FIR或IIR濾波器  網上很多教程都是使用MATLAB的FDATool工具設計濾波器,然后將系數導出,放到IP核中,由IP核根據數據速率核主處理時鐘來決定濾波器的結構。這種設計方式很方便但是不靈活,有時會碰到這種情況:我們需要一個FIR濾波器,數據速率和主處理時鐘速率都很高,甚至一
    網友分享于:2017-06-28 09:02:31
  • 并串轉換FPGA電路構造的探討
    并串轉換FPGA電路結構的探討如題,并串轉換時FPGA設計里,一個很常用的???,這里有一個小的探討。   一般情況下我們可以使用一個計數器與數據選擇器進行并串轉換,如下圖的的結構。這個結構通過計數器不斷的改變數據選擇器的地址端,從而使并行輸入的數據,串行的輸出。
    網友分享于:2017-06-28 09:02:31
  • Xilinx 學習筆記1-新建工程跟創建源代碼文件
    Xilinx 學習筆記1---新建工程和創建源代碼文件  最近終于有空可以記錄一些之前學習的內容,本博客系列記錄筆者Xilinx ISE學習之旅,當然現在Vivado是學習熱門,一步一步來。搞定 ISE,Vivado上手也會很快。
    網友分享于:2017-06-28 09:02:31
  • FPGA基礎知識(4)鎖存器、觸發器、寄存器和緩沖器的區別
    FPGA基礎知識(四)鎖存器、觸發器、寄存器和緩沖器的區別一、鎖存器鎖存器(latch)---對脈沖電平敏感,在時鐘脈沖的電平作用下改變狀態鎖存器是電平觸發的存儲單元,數據存儲的動作取決于輸入時鐘(或者使能)信號的電平值,僅當鎖存器處于使能狀態時,輸出才會隨著數據輸入發生變化。鎖存器不同于觸發器,它不在鎖存數據時,
    網友分享于:2017-06-28 09:02:31
  • FPGA設計模板分享(二)-verilog常用模板分享
    FPGA設計模板分享(2)--verilog常用模板分享 FPGA工程師都知道,Verilog代碼絕大部分都是always語句,結構基本上都是一致的,為了減少重復性的工作,讓工程師專注于設計實現,明德揚精心制作了常用模板,只要你安裝好明德揚提供的GVIM,就能使用這些模板了。1.時序邏輯的模板在GVIM
    網友分享于:2017-05-08 13:29:58
  • 關于Test-Pattern Generator IP核的測試
    關于Test--Pattern Generator IP核的測試關于Test--Pattern Generator IP核的測試 1.Test--Pattern Generator 功能介紹 生成24-bit RGB視頻流,此IP核可以用于系統
    網友分享于:2017-04-20 22:47:07
  • 異步復位、同步開釋機制——系統完美穩定
    異步復位、同步釋放機制——系統完美穩定  白駒過隙,寒假已經余額不足,回頭想想,也就是看了兩本書,做了幾個并不大的工程,看著QQ群里面一些大神們聊天,時不時有的沒的還插幾句,一句話沒人理也是正常事情。有時候還幫同是菜鳥的網友解決問題,好不尷尬!在大神們的只言片語中,也汲取出來一點對行業的認識,數電、
    網友分享于:2017-04-20 22:47:07
  • V3學院帶你學習-縮水漢明碼Hamming(12,8)的FPGA實現
    V3學院帶你學習-縮短漢明碼Hamming(12,8)的FPGA實現此文章為原創出自 V3學院 www.v3edu.org,FPGA培訓專家 漢明碼是一種實現簡單并且可以檢測和糾正錯誤的編碼, 漢明碼是在原編碼的基礎上附加一部分數據比特,使其滿足糾錯碼的條件。它屬于線性分組碼,由于線性碼的編碼和譯碼容易實現,
    網友分享于:2017-05-02 19:55:05
程序員的一天:一寸光陰一寸金
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